verilog吧

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2014-01-04

求大神写一个九选一多路选择器语言

🧑kyoddi

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2014-01-04

吧里有没有会GEM5或者研究GEM5

有没有人会，我想问几个问题。

🧑七夜子风

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2013-12-29

求DAC0832转换的程序

求大神指教，急需程序！万分感激

🧑爱死莎娃

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2013-12-29

有谁帮忙能说一下形成锁存器的条件

🧑孤霜傲雪tj

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2013-12-29

有谁帮忙能说一下形成锁存器的条件

🧑孤霜傲雪tj

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2013-12-29

有谁帮忙能说一下形成锁存器的条件

🧑孤霜傲雪tj

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2013-12-27

求助，谁会用verilog hdl做正弦信号发生器，时钟，频率

🧑樱花一木道

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2013-12-24

eda

穷浪漫 - 杨坤求Verilog Hdl 音乐盒

🧑的的ff

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2013-12-22

问题求解答，急！

设计八路抢答器必须具有互锁功能，即便是绝对同时刻抢答时，电路应通过内部竞争方式，确保每次只能有一个输出有效，该功能无论从实际操作角度还是从理论角度，都必须……

🧑鸥大侠

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2013-12-22

求助，调用子模块是出现的编译错误，请问是哪里错了？

module timer(iCLK_50, oHEX0_D, oHEX1_D, oHEX2_D, oHEX3_D, oHEX4_D, oHEX5_D); ……

🧑sxqqslf1

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2013-12-22

testbench 问题？

我想问一下，我想要测试一下我ADC芯片的逻辑是否正确，现在就是想用testbench产生一个正弦波激励，我知道应该要用到matlab,但是现在却无从下手，……

🧑listenhappy

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2013-12-21

【求助】用verilog能不能直接生成图片，比如bmp，png

verilog能不能直接写二进制数据进去到文件中，然后生成图片，比如bmp，png之类的，还是一定得借助其他语言……网上百度也没有结果，新手求大神指点 P……

🧑星翼allen

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2013-12-18

求大神出现帮忙解答这段代码，简单说明一下大意即可，谢谢！

RT，从同学那弄来一份关于32*32LED点阵控制电路的源代码，接入开发板之后可以显示，但是不会读，报告没法写，希望大神出现帮忙看看这段代码，不用太详细，……

🧑ORCGUARD

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2013-12-17

一个单脉冲发生器的程序，有部分程序，，来个大神帮忙可出血

一个单脉冲发生器的程序，有部分程序，，来个大神帮忙可出血可以私聊或用QQ

🧑xiafei920405

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2013-12-15

刚装的maxplux2，遇到这个问题怎么解决？？

各位大神帮个忙

🧑齐佳倩

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2013-12-12

Verilog 编译不成功一个延时模块出现失踪源节点

module ONE (CLK, RB, DLY_OUT); input CLK, RB; wire Q, QB, CNT_CLK, T_IN; outp……

🧑xiafei920405

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2013-12-11

cordic有ip核吗？求大神给个

🧑弟弟爱乒乓

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2013-12-09

求每段程序流程图

/*数字式竞赛抢答器顶层文本文件设计，以实现整个系统功能*/ moduleqiangdaqi(clk,k,seg,sl,add_min,key_state……

🧑贴吧用户_0XD4GPA

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2013-12-07

大家看看我这个程序为什么不对？

library ieee; use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; e……

🧑sunny啊少

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2013-12-06

求大神解答

moudle qiang (a,b,c,d,a0,b0,c0,d0,rst,clk,lock); input a,b,c,d,rst,clk; outpu……

🧑玄黄大世界fly

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2013-12-05

保险箱控制锁，加防抖设计，哪里错？

module test4(clk,start_n,setup_n,sound,L1,L2,Din); input clk,start_n,setup_n;……

🧑茜仔👀

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2013-12-05

基于verilog语言的停车场显示器的设计求救啊

🧑yzt666888

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2013-12-05

关于出租车计费系统

先不谈代码问题，只求思路。分计费模块，时间模块，计程模块和显示模块。问题就是这个计程模块怎么设计，难道还要加个速度模块？

🧑笃烈太史慈🍁

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2013-12-03

怎么用verilog设计异步清零和同步使能十进制计数器????

🧑liliuzhu1

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2013-12-03

各位大神都用的什么软件啊

如题

🧑笃烈太史慈🍁

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2013-12-02

求大神帮我给数字跑表加个分频器啊跪谢

要能在Basys2 FPGA开发板上显示的就差个分频器了求大神帮忙啊 /*信号定义： CLK： CLK 为时钟信号； CLR：为异步复位信号； PA……

🧑樱花草lwy

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2013-11-29

基于FPGA的步行街道自助式交通灯控制器设计

⑴正常情况下保证主干道的畅通； ⑵当步行街道上的行人要穿过主干道时，通过设置的按钮来发出请求。 ⑶当有人按下此按钮时，主干道变为黄灯，设置计数器计时时间为……

🧑饕餮之暴怒

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2013-11-29

求助：用verilog实现m序列

用verilog实现m序列后，如何映射，就是0映射成1,1映射成-1，求大神帮忙

🧑lk870221

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2013-11-26

新手虚心求问。

想设计一个0~999的3位十进制计数器。

🧑zelos111