verilog吧
发扬硬件描述语言魅力
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2023-05-31
大佬们,这个为啥是非填充数组啊
大佬们,p_array为啥是非填充数组啊 我看是填满了内存啊,求大佬解释
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牛宅酷本拉龙
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2023-05-29
pr怎么关闭参考
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金_鲶
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2023-05-26
大佬帮帮我这个学渣吧
不知道有没有成功,还没写消抖,代码我觉得可能会错的地方发出来了,如图,程序是秒表,
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贴吧用户_QAKDR2K
0
2023-05-20
求帮助,Verilog实现超多数据排序索引
求帮助,Verilog实现超多数据排序索引
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学什么?
2
2023-05-17
吧友们帮帮忙,我这仿真代码写的有什么问题吗
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灰原哀
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2023-05-13
麻烦大佬看一下这个EDA的编程题目
要用Verilog语言实现
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爱你好难1112
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2022-11-05
想问一下大佬们,Verilog怎么实现闰年的判断,我看网上都
想问一下大佬们,Verilog怎么实现闰年的判断,我看网上都是取余,不是说硬件不能这样么,急!
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贴吧用户_5UKR4DX
15
2023-05-09
一个到处可见的代码,较个真always@(posedge C
一个到处可见的代码,较个真 always@(posedge CLK or negedge RSTn) if(!RSTn) 复位语句 ⋯ 好了,这个代码要实……
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坚持天天练😄
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2023-05-08
verilog的for语句7人表决器改成11人的怎么改?
从网上找到的程序 module voter7(pass, vote); output pass; input [6:0] vote; reg [2:0] ……
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harryas
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2023-05-06
求助:代码跑不动
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贴吧用户_5N94JPZ
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2023-04-11
FPGA答疑解惑
指导各类FPGA EDA VERILOG VHDL 设计!
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贴吧用户_5VJ544S
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2023-04-07
求程序语言
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贴吧用户_atQRXGE
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2023-04-10
芯片下载路径
cyclone 4 e在哪里下载
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贴吧用户_a62NJRD
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2023-04-10
modelsim仿真
请问我的仿真为什么没有波形啊?写的仿真文件是不是有什么问题?如图
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WTMUMTW
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2023-04-10
专业设计fpga ,verilog,vhdl,sv,均可、q
专业设计fpga ,verilog,vhdl,sv,均可、quartus,ise,vivado,8年经验,一对一http://tieba.baidu.co……
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小笨笨熊熊笨笨
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2023-04-08
初学verilog
各位大佬,verilog中a=2'b00和a2'b0有区别吗?
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千年回眸等卿归
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2023-04-02
if(~Reset)到底是什么意思
小白一个。 看代码看到if(~Reset)后面是复位操作。可是~Reset不是表示Reset信号为低电平么。所以意思就是当Reset信号为低电平复位?
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CACHIRA
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2023-03-27
用notepad++写verilog,怎么打印出结果
如题
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Zard泉
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2023-03-22
求助
大佬们,我想问下为什么第二张图能证明第一张图,我看不出这两结果有什么关系
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百度网友8ef5397
5
2023-03-21
FPGA,Verilog,PID
菜鸟一枚,最近一直在写PID算法的FPGA实现,用Verilog语言实现,遇到些问题久久不能解决,希望有过类似经历的同胞帮帮忙,希望能向您讨教!有这方面兴……
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bd1443121455
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2023-03-15
verilog综合出错
万能贴吧,有大佬知道下面这个verilog存在什么问题吗,为什么dc综合后倒不出电路
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贴吧用户_76PMt22
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2023-03-14
4年FPGA开发,小项目可接
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module✨
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2023-03-13
请问为什么Modelsim报错Iteration limit reached at time 0 ps.
写了一个很简单的16进制无符号乘法器,但是请问为什么编译通过了但是modelsim仿真报错Iteration limit reached at time ……
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cadae59
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2023-03-09
bishe lunwen 承接所有FPGA相关by设计,基于Verilog,基于vivado或
bishe lunwen 承接所有FPGA相关by设计,基于Verilog,基于vivado或quartus,订金只要10%,具体价格面谈
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罖卛餢嶤覝
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2023-03-08
求助大佬第13题为啥count=0后 V[count]=1?
求助大佬 第13题为啥count=0后 V[count]=1? 为啥呢?不太懂
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把手给我_
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2023-03-07
有没有大佬知道门级网表怎么抽象成有向图
如题,门级网表如何抽象成有向图,现如今有没有软件可以实现这种功能
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叭了个叭叭叭⭐️
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2023-02-20
步行街道自助式交通控制器的设计
⑴正常情况下保证主干道的畅通; ⑵当步行街道上的行人要穿过主干道时,通过设置的按钮来发出请求。 ⑶当有人按下此按钮时,主干道变为黄灯,设置计数器计时时间为……
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嘻嘻哈!!!
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2023-02-15
小白求助这道题输出
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薛定饿的猫🙀
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2023-01-16
求助,verilog实现RSA加解密算法
各位大侠,小弟是Verilog的初学者,现在急需用verilog实现RSA加解密算法,请问下应该怎么做,小弟用C写了RSA的代码,现在不回转化为veril……
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zhjian616
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2023-01-12
汇编语言 8086汇编,x86汇编设计, MIPS
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verFPGA
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