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5
2015-04-21
QuartusII D触发器
我用QuartusII做了一个D触发器,如何利用这个D触发器,做一个4位寄存器。谢谢
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769131547
1
2015-04-19
有没有大神可以帮我解释一下。。
有没有大神可以帮我解释一下。。。。
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莫忘初心的梦想
3
2015-04-18
求大神帮忙 写一段verilog,类似的也行
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紫涵晶玲
1
2015-04-17
急,求一个基本的扫描单元~~~
一个D触发器和一个两输入的多路选择器组成的基本扫描单元的verilog程序~
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苅227
4
2015-04-17
真要命啊,给大神跪了
求写一个4位二进制数转bcd十进制的
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虐杀一切boss
4
2015-04-11
Verilog语言的assign与always分别什么时候用的呢
好像assign 是描述组合逻辑电路的,而always是描述时序逻辑电路的,怎么区分呢,怎么从电路图中看出来是哪个电路呢
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丶也迷
8
2015-04-08
第一行这个“#”是什么用法,“#”不是仿真时延时的吗
mcu_interface #(.BWIDTH(BWIDTH)) u_mcu_interface0 ( .resetz_i (resetz_i), // ……
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fighters4
3
2015-04-08
新手求教哈,局部变量和全局变量怎么写
是localmeter?还是?不对啊,全局呢,globalmeter?也不对啊,还有,局部变量应该写在什么位置,为啥它老是说not
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fighters4
2
2015-04-07
大家一来做FPGA设计和辅导,送助攻了
帮助大家FPGA设计和辅导,QQ:2356650356
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wyf183
8
2015-04-03
不会做卷积码译码器,有没有大神可以帮助的???
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莫忘初心的梦想
4
2015-04-02
送助攻啦
本团队由国内外名校硕士、博士组成,专业从事FPGA开发,特别是在信号处理、图像处理、高速数据采集、工业控制、存储等领域。多年经验,案例丰富,详情联系qq8……
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清水方正大师
7
2015-03-30
谈谈验证环境的搭建
简单介绍一下,只需要用户输入模块的定义部分(verilog代码),就可以生成该模块的验证环境框架。 举个例子:一个模块定义如下 module exampl……
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hiasic_com
4
2015-03-30
求助、一个关于inout接口的问题
一个设备有inout接口、另一个有out、请问这两个接口怎么连接?综合时候报error、
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好不要脸Ω
0
2015-03-29
求问问题
module clk_7segff_sub(input [3:0]NUM,output reg[6:0]a_to_g); always@(*) case(……
🧑
FFJHG
1
2015-03-28
求教程资料
请问大家,谁有关于verilog的学习资料了?小弟跪求我有一些自动化课程视频交换
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神来执手wa
1
2015-03-28
求大神,用QuartusII时,Analysis到图上的时候就不能再运行了
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carl_limingkun
0
2015-03-27
ise没有找到clock wizard怎么分想要的频啊
计数分频分不出想要的,wizard在哪啊?我是spartan3a的,ise14.7版本
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fighters4
13
2015-03-27
求指导IIC的毕业设计
有大神会iic吗?求指导
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谁枫而欢
0
2015-03-27
verilog 提示 unsupported modelsim library format for work
求助 这个错误该怎么解决
🧑
贴吧用户_01UtNQK
1
2015-03-26
verilog问题,新手求帮助
reg [2:0] CLK_S_edge; reg CLK_S_handle; //把CLK多采集几次作为新的CLK always @(posedge c……
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daykim0808
0
2015-03-25
我是可恶的伸手党,求助各位大神
用xilinx ISE 编个4位二进制数转换成十进制的module,谁给写一下啊,刚学一星期,老师就让自己做,完全没接触过啊
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虐杀一切boss
6
2015-03-22
下学期学Verilog,求大神指点下如何入门?
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urmwod
1
2015-03-22
IIC协议的参考文献怎么写
在论文中用到了IIC协议,但是在参考文献中不晓得怎么写
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谁枫而欢
0
2015-03-22
求一个38译码器的测试码
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Burford123
0
2015-03-22
求大神相助!能不能把VHDL翻译成verilog呀
在程序中定义5个开关, 对于SW1-SW5这5个开关,每打开一个开关, 对应控制一种LED灯显示的方式.,SW1:对应LED依次点亮,SW2:对应LED依……
🧑
未眠雨夜
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