verilog吧

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2016-06-09

求问表达式？2：-1中-1是什么意思

是报错的意思吗

🧑封印的猴子

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2016-06-09

大神们，，，有没有Verilo

大神们，，，有没有Verilog语言的编程软件，，，，有大神经常看帖吗？？本人过两天有数字逻辑上机，编写简单的程序，有人可以教吗？

🧑shine小呆happy

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2016-06-07

求助莫名报错标点问题查了半天

调用了ieee 莫名报错

🧑凭轩听雨54

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2016-06-02

题目：小型运算器--按键控制和显示模块设计 Verilog HDL语言

有会的吗求带求教学临近答辩了徒伤悲

🧑Lucifawindy

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2016-06-02

六十进制同步可预置数计数器 verilog程序

刚学不久，有大神给看下么，如题！

🧑叽哩哇啦咕噜哩

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2016-06-01

求一个verilog HDL 写的fsk调制解调器设计求一个

求一个verilog HDL 写的fsk调制解调器设计程序

🧑平行线下的微笑

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2016-05-29

我想问问用FPGA做游戏，VG

我想问问用FPGA做游戏，VGA显示，用什么VGA显示器啊？

🧑阳光的xiaobiao

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2016-05-29

基于fpga的cache替换算法控制器设计，这个课题是不是很难啊

🧑托尼克⁠罗斯

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2016-05-28

求助，Vivado在综合的时候出现错误。。。

这里显示的错误是： [Synth 8-3380] loop condition does not converge after 2000 iteratio……

🧑帅个70

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2016-05-27

quartus编译出来的都是什么

quartus编译出来的都是什么，如果我想知道用了多少门电路从这里可以看出来吗

🧑看那繁星点点7

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2016-05-25

编写verilogVHDL的软

编写verilogVHDL的软件，哪位大神有，帮忙给个链接

🧑a椅栏

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2016-05-23

verilog,fpga等代做，有问题可以找我哦

🧑加Q1208375953

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2016-05-22

悬赏大神来帮忙

求一个RS编解码器的程序，能实现编码和解码功能，不论系数哦

🧑niceDIDA10086

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2016-05-22

这个显示程序怎么理解呢

module seg7v ( input clk, input [3:0] data1,data2,data3,data4,data5,data6,out……

🧑且可秀

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2016-05-21

大二狗，自己编的最简单数字频率计的代码，逻辑有错误，求救啊！

module shuzi(input CLK,input sign,output reg [11:0] display_out,output HZ,out……

🧑陌风DY

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2016-05-19

写出了非模块文件怎么搞啊

🧑话说灬🔥

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2016-05-18

verilog 问题

正在做rs(204,488)的解码器，发现纠错功能实现不了，能纠错但是纠错的不对，有人能提供帮助吗

🧑niceDIDA10086

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2016-05-18

求助大神

原理图产生vhdl程序时没有错误但是编译代码时出现了错误，求大神帮忙。附源程序及原理图

🧑翡泪

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2016-05-18

请教一个verilog问题

module top (flash_led,run_led,clk,reset) input clk,reset; output flash_led; o……

🧑sparkyou

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2016-05-17

求问verilog中的?:?:表达式的意思

请问verilog中的？：？：是怎么回事？ assign Databus = (Address_on_Databus) ? Address : (ALU_……

🧑CAOXIAYANJIE

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2016-05-15

求大神帮忙

画?的部分是什么意思啊

🧑永远爱style

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2016-05-14

verilog设计辅导

qq:2356650356

🧑yuinjun007

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2016-05-13

简单的38译码器时序仿真输出波形遇到不确定的问题求助！

就是坑爹的红线问题额。。。吧里有大神专门发微博细讲了，可是楼主菜鸡还是发现不了问题，没办法只能求助了。

🧑asswecant

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2016-05-13

verilog大神请进。。。跪求。。。急急急

最近用verilog编了一个程序大概1000行左右我用quartusii软件编译后看到模块的最大工作时钟频率大概64mhz 大神有没有什么办法使工作时钟……

🧑风暴大脑