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10
2019-03-25
《基于IIC总线的verilog设计》该咋弄，学过eda和a
《基于IIC总线的verilog设计》该咋弄，学过eda和arm中的iic，但是快忘得差不多了，大佬们教教我。可有偿！
🧑☞Hola☜
8
2019-03-25
用verilog写个算法的代码，会的滴滴我有偿！
用verilog写个算法的代码，会的滴滴我有偿！
🧑髙山映红
2
2019-03-25
仿真结果怎么和要求不一样呢，漏掉了几个数
仿真结果怎么和要求不一样呢，漏掉了几个数
🧑乌拉q-
4
2019-03-25
求助，编译一直有错误，还找不出来，求帮忙看一下
序列号1001的检测
🧑ZJJ狮子
1
2019-03-25
用到了quartus的IP核，NCO ip核。signalt
用到了quartus的IP核，NCO ip核。signaltal Ⅱ图片在下面。示波器我都有了。出不来正确的图，有谁会吗？50
🧑WHMXTu
6
2019-03-25
小小萌新刚开始接触verilog，想做个4分频，不知哪里出了
小小萌新刚开始接触verilog，想做个4分频，不知哪里出了问题做不出来，求大佬指点指点
🧑tzwilson98
2
2019-03-14
quartus使用了IP核，在示波器上无法显示正常波形，如何
quartus使用了IP核，在示波器上无法显示正常波形，如何解决
🧑WHMXTu
0
2019-03-10
ise ，试着仿真程序一直显示错误，不知道怎么修改，求大佬解决
🧑十年高考俩茫茫
4
2019-03-05
有没有dalao知道怎么把这个vhdl语言转化成verilo
有没有dalao知道怎么把这个vhdl语言转化成verilog语言啊，求助
🧑樱染醉倾城
1
2019-02-25
求助！！5道判断题有人会吗
求助！！5道判断题有人会吗
🧑crazy_peepz
0
2019-02-22
quartus 2 支持verilog的开关级（晶体管级）建模吗？
quartus 2 支持verilog的开关级（晶体管级）建模吗？或者有其他软件支持这个功能的吗？
🧑hws传奇
1
2019-03-25
直接数字频率合成器dds有大神了解吗，自己有想法对其进行改进
直接数字频率合成器dds有大神了解吗，自己有想法对其进行改进，比较复杂写代码不太会，有能帮忙的吗，有偿，扣扣275732281
🧑baolangeng2010
5
2019-02-18
求大佬解答！！
求大佬解答！！
🧑ffzxcyt
8
2019-02-13
这个怎么解决，没的选，昨天还可以用的，今天突然就不行了。
这个怎么解决，没的选，昨天还可以用的，今天突然就不行了。
🧑桀念AJ
1
2019-02-06
请问这句代码什么意思assign#（4,6,8）Due=&DataBus
assign#（4,6,8）Due=&DataBus 求大神解释一下（卷子里的一道填空题，只有这么一行）
🧑winnei第一名
1
2019-01-28
关于verilog图像处理的问题
新手上路，最近遇到个问题，verilog仿真要怎么读写bmp位图文件，主要是储存？ 求dalao解答
🧑1402418700
1
2019-01-22
分享贴子
分享贴子
🧑打广告看考场
4
2019-01-22
Verilog乘法器，有大佬帮帮忙吗
乘法器 设计一个能进行两个十进制数相乘的乘法器，乘数和被乘数均小于100，通过按键输入，并用数码管显示，显示器显示数字时从低位向高位前移，最低位为当前显示……
🧑van11071
2
2019-01-12
请问有人知道怎么写一个用拨码开关控制的呼吸灯呢，谢谢
请问有人知道怎么写一个用拨码开关控制的呼吸灯呢，谢谢
🧑kilhrdcu
6
2019-01-09
请问各位，16×16点阵的动态扫描用Verilog怎样实现，
请问各位，16×16点阵的动态扫描用Verilog怎样实现，有没有基本框架？
🧑噢嗯噢噢丶
5
2019-02-18
求大佬帮忙代写。。有偿
🧑雁城雪Sama
3
2019-01-02
求助，急！求大佬代写，有偿！
用Verilog-HDL语言描述一个进制转换器，其主要功能是实现十进制到非十进制的转换和显示，包含以下几个内容： 1）输入模块为键盘，包括16个按键：0-……
🧑Deadpool08081
0
2019-01-01
mips 五级流水cpu哪个大佬搞过
🧑泽哥哥🍀
2
2018-12-30
舅舅大师兄！！！！！！
舅舅大师兄！！！！！！
🧑如梦似幻🌿
0
2018-12-29
求教，下板后vga显示信号不支持，一般可能是什么问题呢 分辨
求教，下板后vga显示信号不支持，一般可能是什么问题呢 分辨率方面的吗
🧑丿未西示
1
2018-12-24
小白求助，quartus内置的template怎么用
大哥们，我在写代码时发现有“insert template”可以用，插入了DFF和LCELL模板编译也通过了，可modelsim仿真不了好像是缺少内置模板……
🧑virtute
1
2018-12-24
verilog写一个1602液晶屏显示ps2输入的代码，有偿200
verilog写一个1602液晶屏显示ps2输入的代码，有偿200
🧑Crazy_恩
1
2018-12-18
关于Verilog多个module功能改成一个module实
关于Verilog多个module功能改成一个module实现会有不同吗
🧑王员外809
1
2018-12-17
两个程序都出现IO口设计太多，可以如何解决？
🧑木子发誓
1
2018-12-14
关于alter_pll的问题
关于alter_pll的问题 我用quartus生成了一个pll的IP core，然后想用NC_verilog仿真，但是在生成的VO文件中调用了一个叫al……
🧑单词用记吗
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